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针对数字视频图像采集及其显示系统中高速实时的数据需要缓存的问题，提出一种基于FPGA的SDRAM控制器设计。在研究SDRAM的逻辑结构的基础上，利用Verilog语言实现了SDRAM的初始化以及读写操作，同时提出一种仅使用一块SDRAM进行数据写入和读出的乒乓操作的方法，并且使用FIFO实现了异步时钟数据的交换。实验仿真波形图表明该设计能很好的实现SDRAM控制器的数据缓存以及数据读写的乒乓操作。