【摘 要】
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设计了一种高性能低功耗的10 bit 100 MS/s逐次逼近寄存器（SAR）模数转换器（ADC）.基于优值（FOM）设计了一种数模转换器（DAC）单元电容确定法,从而实现了ADC性能和功耗之间的最优折中,得
【机 构】
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中国科学技术大学物理学院,中国科学院微电子学院,北京中科睿微电子技术有限公司模拟射频部
【基金项目】
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国家发改委移动互联网及第四代移动通信（TD-LTE）产业化专项资助项目
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设计了一种高性能低功耗的10 bit 100 MS/s逐次逼近寄存器（SAR）模数转换器（ADC）.基于优值（FOM）设计了一种数模转换器（DAC）单元电容确定法,从而实现了ADC性能和功耗之间的最优折中,得到了最小的后仿真优值为17.92 f J/步,以及与之对应的最优单元电容值1.59 f F.为了减小输入共模电压变化引起的信号敏感性失调,设计了改进的P型输入动态预放大锁存比较器,比较器采用共源共栅结构（cascode）作为P型预放大器的偏置,从而增加了预放大器的共模抑制比（CMRR）.模数转换器采用
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