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位平面解码器作为JPEG2000解码系统中算法复杂、运算量最大的组件，限制了解码器的工作效率，为此，以下提出了一种上下文预测算法，并将该算法与基于组的像素点跳跃算法混合使用，实现了数据处理的流水线操作，提高了位平面解码器的工作速度。并采用VerilogHDL硬件描述语言进行了RTL级描述，经过功能仿真和DC综合，最高工作频率可达100MHz，内嵌到JPEG2000解码器系统中，可满足图像实时解码的要求。