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ST-BUS是广泛应用于E1通信设备内部的一种模块间通信总线。结合某专用通信系统E1接口转换板的设计,本文对ST-BUS总线进行了介绍,讨论了ST-BUS总线接口收发模块的设计方法,给出了VerilogHDL实现和模块的时序仿真图。
ST-BUS总线接口模块的Verilog HDL设计
【摘 要】
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ST-BUS是广泛应用于E1通信设备内部的一种模块间通信总线。结合某专用通信系统E1接口转换板的设计,本文对ST-BUS总线进行了介绍,讨论了ST-BUS总线接口收发模块的设计方法,给
【机 构】
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成都电子科技大学通信与信息工程学院,四川农业大学信息与工程技术学院,成都电子科技大学电子工程学院
【出 处】
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电子设计应用
【发表日期】
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2006年09期
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