【摘 要】
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Turbo乘积码（ TPC ）作为一种高码率编码在带限通信系统中有着广泛的应用,但是大多数 TPC译码器存在结构复杂、资源消耗高、处理时延大的问题.为此,提出了一种交错并行流水线处
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Turbo乘积码（ TPC ）作为一种高码率编码在带限通信系统中有着广泛的应用,但是大多数 TPC译码器存在结构复杂、资源消耗高、处理时延大的问题.为此,提出了一种交错并行流水线处理 结构的译码器,并通过译码过程中测试序列的合理排序以及使用相关运算代替最小欧式距离计算等 算法优化设计,简化了译码器的实现复杂度,现场可编程门阵列（ FPGA ）资源消耗相比传统设计降低 了 35% ,提高了译码速度.在 Xilinx公司的F PGA芯片XC5VSX95T 上完成了译码器的硬件实现,达 到80 Mbit/s的译
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