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SystemVerilog和SystemC不久前依然被视为相互排斥的两种环境,而现在可以相互协作,并为实现设计和验证方法提供平滑流畅的系统.
新的系统级语言模式为SoC设计人员提供整合设计环境
【摘 要】
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SystemVerilog和SystemC不久前依然被视为相互排斥的两种环境,而现在可以相互协作,并为实现设计和验证方法提供平滑流畅的系统.
【出 处】
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世界电子元器件
【发表日期】
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2003年7期
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