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介绍了一种基于现场可编程门阵列(FPGA)和第二代双倍数据率同步动态随机存取记忆体(DDR2)的高速模数转换(ADC)采样数据缓冲器设计方法,论述了在Xilinx V5 FPGA中如何实现高速同步时钟设计和高速数据同步接收设计。
基于FPGA与DDR2 SDRAM的高速ADC采样数据缓冲器设计
【摘 要】
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介绍了一种基于现场可编程门阵列(FPGA)和第二代双倍数据率同步动态随机存取记忆体(DDR2)的高速模数转换(ADC)采样数据缓冲器设计方法,论述了在Xilinx V5 FPGA中如何实现高速
【机 构】
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船舶重工集团公司723所
【出 处】
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舰船电子对抗
【发表日期】
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2010年01期
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