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时钟偏移是同步数字集成电路设计中的一个难题。本文分析了时钟偏移产生的机理以及对电路性能的影响。
同步数字集成电路设计中的时钟偏移分析
【摘 要】
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时钟偏移是同步数字集成电路设计中的一个难题。本文分析了时钟偏移产生的机理以及对电路性能的影响。
【机 构】
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武汉职业技术学院电子信息工程系
【出 处】
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电脑知识与技术(学术交流)
【发表日期】
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2007年6期
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