【摘 要】
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本文针对在语音、视频等信号处理中出现的变速率信号处理,提出了一种新型的高速高效可重构流水线乘法器电路,并在0.25μm工艺条件下对电路进行了仿真。该电路通过控制流水级
【机 构】
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西北工业大学第365研究所,西北工业大学第365研究所,西安邮电学院电信系 陕西西安710069,陕西西安710069,陕西西安710121
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本文针对在语音、视频等信号处理中出现的变速率信号处理,提出了一种新型的高速高效可重构流水线乘法器电路,并在0.25μm工艺条件下对电路进行了仿真。该电路通过控制流水级数处理变速信号,可有效地节约电路资源约34%,同时可保证频率达1.8GHz的高运算速度。
In this paper, a novel high speed reconfigurable pipeline multiplier circuit is proposed for variable rate signal processing in signal processing such as speech and video. The circuit is simulated under 0.25μm process conditions. The circuit by controlling the variable speed signal processing steps, which can effectively save about 34% of circuit resources, while ensuring high frequency of 1.8GHz operation speed.
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