一种改进的GALS异步包装电路

来源 :浙江大学学报(理学版) | 被引量 : 0次 | 上传用户：wqc851109

【摘要】

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GALS（全局异步、局部同步）架构适用于NoC的时钟分布,但现有的GALS需要定制地设计异步包装电路,不利于验证和集成.采用通用的数字ASIC设计流程,在仅使用已有标准单元的情况下,提

【作者】

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董文箫陈华锋沈海斌

【机构】

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浙江大学超大规模集成电路设计研究所,浙江传媒学院电子信息学院

【出处】

：

浙江大学学报(理学版)

【发表日期】

：

2011年3期

【关键词】

：

片上网络时钟分布 2相双轨异步包装全局异步局部同步 networks on chip clock distributing 2-phase dual

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GALS（全局异步、局部同步）架构适用于NoC的时钟分布,但现有的GALS需要定制地设计异步包装电路,不利于验证和集成.采用通用的数字ASIC设计流程,在仅使用已有标准单元的情况下,提出了一种新的基于FIFO的异步包装.通过此包装电路,实现了一个信号传输只需2步操作,提高了通信吞吐率.实验结果表明该包装电路在吞吐率和延迟上获得了显著改进.

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