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针对1000BASE—T中的均衡解码结构，从信噪比与误码率、速度及硬件复杂度等方面比较了该判决反馈均衡解码器的几种形式，并设计了一种满足速度与误码率要求而硬件复杂度更低的混合型结构，该结构将部分残留后馈干扰级数移除，同时应用流水线及重定时技术优化其性能。
混合型判决反馈均衡器设计与FPGA实现
【摘 要】
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针对1000BASE—T中的均衡解码结构，从信噪比与误码率、速度及硬件复杂度等方面比较了该判决反馈均衡解码器的几种形式，并设计了一种满足速度与误码率要求而硬件复杂度更低的混
【机 构】
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中南大学信息科学与工程学院
【出 处】
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微型机与应用
【发表日期】
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2012年5期
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