改进型booth华莱士树的低功耗、高速并行乘法器的设计

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【摘要】

：

采用一种改进的基-4BOOTH编码和华莱士树的方案，设计了应用于数字音频广播（DAB）SOC中的FFT单元的24×24位符号定点并行乘法器．通过对部分积的符号扩展、（k：2）压缩器、连线方式和

【作者】

：

王定余宁梅张玉伦宋连国

【机构】

：

西安理工大学电子工程系

【出处】

：

电子器件

【发表日期】

：

2007年1期

【关键词】

：

乘法器 BOOTH编码华莱士树 (k:2)压缩器最终加法器分割算法 multiplier booth encoder wallace tree （

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采用一种改进的基-4BOOTH编码和华莱士树的方案，设计了应用于数字音频广播（DAB）SOC中的FFT单元的24×24位符号定点并行乘法器．通过对部分积的符号扩展、（k：2）压缩器、连线方式和最终加法器分割算法的优化设计，可以在18．81ns内完成一次乘法运算．使用FPGA进行验证，并采用chartered 0．35μm COMS工艺进行标准单元实现，工作在50MHz，最大延时为18．81ns，面积为14329．74门。功耗为24．69mW．在相同工艺条件下，将这种乘法器与其它方案进行比较，结果

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