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VLSI版图规划中的单元时延优化方法
VLSI版图规划中的单元时延优化方法
来源 :杭州电子工业学院学报 | 被引量 : 0次 | 上传用户:gaolei19890917
【摘 要】
:
VLSI的时延优化问题是设计高性能的VLSI的重要问题。本文提出了在VLSI布图的版图规划中优化单元内时延的方法,并首先导出路径时延与单元面积的关系,从而运用数学规划方法得到优
【作 者】
:
戚肖宁
冯之雁
【出 处】
:
杭州电子工业学院学报
【发表日期】
:
1994年2期
【关键词】
:
集成电路
时延
版图规划
VLSI
最佳化
IC Timing Drirven Layout Floorplanning
【基金项目】
:
国家“八·五”攻关项目
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VLSI的时延优化问题是设计高性能的VLSI的重要问题。本文提出了在VLSI布图的版图规划中优化单元内时延的方法,并首先导出路径时延与单元面积的关系,从而运用数学规划方法得到优化了的单元面积。结果表明,这是一个有效的单元代化方法。
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