【摘 要】
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针对高速（Gb／s）串行数据通信应用，提出了一种混合结构的高速时钟数据恢复电路．该电路结构结合鉴频器和半速率二进制鉴相器，实现了频率锁定环路和相位恢复环路的同时工作．电路采用1．8v
【机 构】
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复旦大学专用集成电路国家重点实验室
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针对高速（Gb／s）串行数据通信应用，提出了一种混合结构的高速时钟数据恢复电路．该电路结构结合鉴频器和半速率二进制鉴相器，实现了频率锁定环路和相位恢复环路的同时工作．电路采用1．8v，0．18μm、CMOS工艺流片验证，面积约0．5mm^2，测试结果显示在2Gb／s伪随机数序列输入情况下，电路能正确恢复出时钟和数据，核心功耗约为53．6mW，输出驱动电路功耗约64．5mW，恢复出的时钟抖动峰峰值为45ps，均方根抖动为9．636ps．
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