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[学位论文] 作者：袁珩洲,,
来源： 年份：2014
集成电路技术迅猛发展,对数字芯片中时钟信号的品质要求越来越高。时钟信号的输出分辨率、相位噪声、变频时间等指标直接决定了整个时钟产生系统的性能好坏。小数分频型锁相...
[学位论文] 作者：袁珩洲,,
来源：国防科技大学 年份：2019
我国航天事业不断前进,天基互联网得到快速发展,海量数据导致星上系统的信号处理能力亟需提升。星上系统的信号处理能力由处理器性能和片间通信能力决定,因为PLL为处理器、Se...
[期刊论文] 作者：胡星,邝继顺,袁珩洲,李少青,,
来源：计算机科学 年份：2014
随着数据处理能力的不断提高,高速接口的应用越来越广泛.高速接口的测试难度较大,需要依靠工程师的经验和较长时间的分析才能确定故障的类型和位置.通过故障状态下高速接口的...
[期刊论文] 作者：宋意良,袁珩洲,刘尧,梁斌,郭阳,,
来源：计算机工程与科学 年份：2016
基于宽频率范围数字系统的需求，在0．13μm工艺下设计了一款宽输出范围、低抖动八相位锁相环。首先通过数学建模优化环路带宽，在系统级减小环路噪声；在振荡器中引入了前馈传输管单......
[会议论文] 作者：宋志杰, 窦强, 刘尧, 袁珩洲, 梁斌,,
来源： 年份：2004
本文在130nm CMOS工艺下提出了一款具有高精度延时单元的延时电路。所提出的电路通过锁相环技术与可编程延时技术,与传统延时电路相比,所提出的延时电路误差低于5%,具有更高...
[期刊论文] 作者：张孝,马卓,谢伦国,余金山,袁珩洲,王志强,,
来源：计算机工程与科学 年份：2015
时间数字转换器TDC是全数字锁相环ADPLL相位捕获的重要部件。以TDC分辨率的提升为主线，讨论了计数器型、门延迟和亚门延迟型三类全数字TDC的基本结构，从提高分辨率、增加动态范...
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