【摘 要】
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本文提出了一种快速有效的信道编码译码器的硬件仿真方案。基于TURBO乘积码迭代译码原理,介绍了译码器硬件仿真的基本思路,开发了译码器硬件仿真模型,并在此基础上对硬件仿真
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本文提出了一种快速有效的信道编码译码器的硬件仿真方案。基于TURBO乘积码迭代译码原理,介绍了译码器硬件仿真的基本思路,开发了译码器硬件仿真模型,并在此基础上对硬件仿真模型进行了优化,搭建了基于TURBO乘积码的优化仿真模型,在此模型上进行了硬件仿真,给出了不同信噪比输入情况下硬件仿真的误码率结果和SNR=9dB时的仿真波形,硬件仿真效率相比以往利用软件仿真,在达到10E-9的误码率情况下,仿真时间大致为1:10,大大提高了译码器译码性能的仿真效率。通过灵活改变编解码模块,应用到任何信道纠错译码模块的硬件仿真中都是非常有效和可行的。
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