【摘 要】
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SerDes芯片是一种高速串并转换接口芯片,即采用时分多路复用(TDM)、点对点的通信技术,在发送端多路低速并行信号被转换成高速串行信号,经过传输媒体(光缆或铜线),最后在接收
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SerDes芯片是一种高速串并转换接口芯片,即采用时分多路复用(TDM)、点对点的通信技术,在发送端多路低速并行信号被转换成高速串行信号,经过传输媒体(光缆或铜线),最后在接收端将高速串行信号重新转换成低速并行信号。本文设计了基于SerDes芯片的8b/10b编解码电路,详细介绍了从前端代码到后端APR生成版图的整个设计流程。SerDes芯片的编解码模块是基于IBM公司于1983年发明的8b/10b编码协议进行设计的。8b/10b编码方式的特点是:数据流中连续的“1”或“0”个数不超过5个,避免传输中数据的丢失;具有DC补偿功能,不会出现DC偏移;可根据编码规则检测错误信息;采用特殊字符进行控制。本论文设计的8b/10b编解码模块采用Verilog HDL语言完成各个模块的RTL级电路功能设计;用Synopsys公司的综合工具Design Complier进行门级电路综合;用Synopsys公司的自动布局布线工具Astro进行最终的版图设计;并基于Hsim和NC-Verilog的数模混合搭建仿真平台,通过数模混合仿真完成对全芯片功能的验证。8b/10b编解码模块采用SMIC 0.13um的工艺库实现,完成的8b/10b编解码模块将以硬核的形式应用于SerDes芯片设计的项目中。
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