【摘 要】
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高速SerDes接口由于其传输速度快、可靠性高、连接简单的特点而成为未来通信总线发展的主要方向。目前国内很多CPU、FPGA和DSP等电路高速接口的测量大多采用由设计来保证的自测试或者板级验证的方式,这会带来特征参数测试不充分和测试效率低的问题。因此需要构建自动化测试平台满足SerDes接口芯片特征参数的高质量测试。本课题设计高速SerDes接口芯片测试所需的器件接口板（Device Interf
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高速SerDes接口由于其传输速度快、可靠性高、连接简单的特点而成为未来通信总线发展的主要方向。目前国内很多CPU、FPGA和DSP等电路高速接口的测量大多采用由设计来保证的自测试或者板级验证的方式,这会带来特征参数测试不充分和测试效率低的问题。因此需要构建自动化测试平台满足SerDes接口芯片特征参数的高质量测试。本课题设计高速SerDes接口芯片测试所需的器件接口板（Device Interface Board,DIB）和开发测试程序,在自动测试系统（Automatic Test Equipment,ATE）上完成芯片的功能验证和高速接口的抖动、眼图等特征参数的一致性测试。具体研究内容如下:（1）SerDes测试方法的研究。在确保SerDes接口芯片进行数据传输的功能正确的基础上,研究共模电压、上升/下降时间、抖动等特征参数的测试方法,采用搜值的方法设计测试程序去实现接口参数的测试。（2）总体测试方案设计。研究高速SerDes接口芯片的基本原理,结合自动测试系统,确定基于ATE串行回环的具体测试方案,解决高速接口测试效率低下的问题。根据测试需求设计自动化测试流程,完成待测芯片的功能验证和关键参数的测试。（3）测试平台构建及硬件设计。设计PRBS产生电路发送测试向量和误码率检测电路判断输出响应。分析待测电路数字通道需求和电源需求,确定ATE所需的板卡资源,设计优良的DIB板,分析DIB板的损耗并对其进行仿真验证,确保DIB板高速通道的信号完整性。（4）结果分析验证。基于CTC2118型So C产品进行测试程序的设计调试,分析测试结果验证设计方案的可行性。本课题基于ATE设备设计了一套SerDes接口的测试方案,完成了测试平台的硬件设计、软件测试程序设计及功能验证测试。实现了最高传输速率为5Gbps,最大数据吞吐量达到25Gbps的高速SerDes接口芯片的物理层参数测试,测试结果与标准仪器测量结果一致。
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