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适用于MPEG2视频解码的RISC和VLD电路设计与实现
适用于MPEG2视频解码的RISC和VLD电路设计与实现
来源 :复旦大学 | 被引量 : 0次 | 上传用户:fenghui111
【摘 要】
:
全文包括以下四部分内容:1、讲述该系统两个模块的设计方法以及相应流程2、是该文的核心部分,对RISC CPU各模块的电路设计作了逐一说明3、讲述VLD控制部分的各个模块的电路设
【作 者】
:
何寅
【机 构】
:
复旦大学
【出 处】
:
复旦大学
【发表日期】
:
2000年期
【关键词】
:
流水线
RISC
VLD
IP核
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全文包括以下四部分内容:1、讲述该系统两个模块的设计方法以及相应流程2、是该文的核心部分,对RISC CPU各模块的电路设计作了逐一说明3、讲述VLD控制部分的各个模块的电路设计.4、讲述高速电路板的设计以及FPGA验证过程.第六章是全文总结.
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