高速Pipelined-SAR ADC的低功耗技术的研究与设计

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物理世界中,我们能接触到信号都是模拟的。模拟信号作为易于理解的连续信号,当需要在电子设备中进行存储和传输时,必须要转换为二进制的数字信号。因此我们可以说模数转换器是连接物理世界和虚拟电子世界的桥梁。由于模数转换器结构复杂,模块众多,所以在集成电路设计中常常成为设计者的重心之一。近年来,随着5G通信技术的普及,人们对于高带宽、高码率的需求愈发强烈。然而在便携式设备(如智能手机、平板电脑)的电池技术没有大幅度提升的前提下,如何在更低的功耗下实现更高的信号处理和传输速率成为了工业界和学术界研究和开发的热点话题。两步式Pipelined-SAR ADC是现今运用广泛的高速低功耗模数转换器解决方案,它很好地结合了SAR ADC数字化程度高和功耗低,以及Pipelined ADC易于达到较高的带宽的优点,是一种典型的混合架构ADC。本文针对传统的PipelinedSAR ADC,分析它的系统功耗中还可以继续优化之处,指出从残差放大器的结构和时序上入手,可以进一步降低系统功耗。基于这个想法,本文设计了一款基于高线性度低功耗的开环放大器的两步式Pipelined-SAR ADC,通过基于MATLAB的系统行为级建模和基于Cadence Virtuoso的电路设计仿真,验证了提出想法的可行性。本设计基于28nm的CMOS工艺,在0.9V电源电压下实现了500MS/s采样率和12位精度。在对系统输入奈奎斯特频率的满幅度信号时,系统实现的SINAD是63.88d B,SNR是64.63d B,SFDR是75.40d B,通过计算得到有效位数为10.32位。
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