【摘 要】
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本文设计的是一种基于上华0.6μm CMOS工艺,20MHz、10Bit的流水线型A/D转换器。采用1.5位/级的九级流水线结构,前八级为每级1.5位的FLASH结构,第九级为2位FLASH结构,采用冗余
【出 处】
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华北电力大学(保定) 华北电力大学
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本文设计的是一种基于上华0.6μm CMOS工艺,20MHz、10Bit的流水线型A/D转换器。采用1.5位/级的九级流水线结构,前八级为每级1.5位的FLASH结构,第九级为2位FLASH结构,采用冗余矫正的方法进行数字校正。首先应用MATLAB软件对模数转换器进行行为级的建模以及仿真,确定各个模块的性能参数为后面电路设计提供依据。子模块电路设计中主要完成了高精度的采样保持电路、高增益带宽的套筒式运算放大器电路、低功耗比较器电路、1.5位和2位结构子模数转换电路以及数字校正电路的设计。在输入频率为1.04278MHz,采样频率为20MHz时,模数转换器的信噪比为58.7dB,即具有9.46位的有效位数。最后在分析了版图设计的注意事项后,给出了部分主要单元电路的版图。
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