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本文主要针对高速电路DDR2硬件设计中,影响信号SI和PI的各种相关因素做了介绍。对于在8层电路板里设计800Mbps以上的DDR2是可行的,实现DDR2时序匹配和信号的准确性和完整性。
DDR2硬件设计中反射的消除
【摘 要】
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本文主要针对高速电路DDR2硬件设计中,影响信号SI和PI的各种相关因素做了介绍。对于在8层电路板里设计800Mbps以上的DDR2是可行的,实现DDR2时序匹配和信号的准确性和完整性。
【机 构】
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内蒙古机电职业技术学院电气工程系
【出 处】
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山东工业技术
【发表日期】
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2015年3期
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