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介绍了利用VHDL硬件描述语言结合FPGA可编程器件进行数字钟的设计,并通过数码管驱动电路动态显示计时结果.通过本例可以为其他电路的设计提供一定的借鉴作用.
基于FPGA的数字钟设计
【摘 要】
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介绍了利用VHDL硬件描述语言结合FPGA可编程器件进行数字钟的设计,并通过数码管驱动电路动态显示计时结果.通过本例可以为其他电路的设计提供一定的借鉴作用.
【机 构】
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北京工业大学电子信息与控制工程学院北京100022
【出 处】
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现代电子技术
【发表日期】
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2004年22期
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