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一种在VLSI电路物理设计中减小串扰的优化算法
一种在VLSI电路物理设计中减小串扰的优化算法
来源 :计算机辅助设计与图形学学报 | 被引量 : 5次 | 上传用户:yaodmangrady
【摘 要】
:
通过研究调整线段和线间距对串扰的影响 ,提出了一种在布线时通过采取作线段摄动和压缩线间距的措施来减小串扰的优化算法 .计算机仿真结果表明 ,该算法能有效地减少芯片中的串扰 .此外 ,可预期算法能应用于布线区域不规则的情形
【作 者】
:
张徐亮
赵梅
范明钰
李春辉
虞厥邦
黄劲
【机 构】
:
电子科技大学信息中心,中国科学技术大学研究生院计算机科学系,电子科技大学光电子技术系,AmbowCorporation
【出 处】
:
计算机辅助设计与图形学学报
【发表日期】
:
2001年04期
【关键词】
:
超大规模集成电路
物理设计
串扰最小化
优化算法
VLSI
计算机仿真
VLSI circuit's physical design
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通过研究调整线段和线间距对串扰的影响 ,提出了一种在布线时通过采取作线段摄动和压缩线间距的措施来减小串扰的优化算法 .计算机仿真结果表明 ,该算法能有效地减少芯片中的串扰 .此外 ,可预期算法能应用于布线区域不规则的情形
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