一种基于E语言的芯片验证平台优化方法

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：kingsword001

【摘要】

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针对传统基于E语言的ASIC芯片验证环境的仿真低效率,本文提出了一种优化手段,即在E语言实现的验证环境里只做数据相关处理,时序的处理采用verilog实现,以减少软件Specman Eli

【作者】

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张妮娜王万财窦衡

【机构】

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电子科技大学电子工程系,华为技术有限公司海思传送芯片开发部

【出处】

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微电子学与计算机

【发表日期】

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2012年4期

【关键词】

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芯片验证 E语言 ASIC SDH verification E language ASIC SDH

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针对传统基于E语言的ASIC芯片验证环境的仿真低效率,本文提出了一种优化手段,即在E语言实现的验证环境里只做数据相关处理,时序的处理采用verilog实现,以减少软件Specman Elite与verilog仿真器的通信次数.最后以SDH处理芯片的验证为例进行实验对比,结果证明了此种实现方式的可行性,并且测试用例的仿真时间在原基础上能缩短50%～70%,对降低芯片的整个设计周期具有显著意义.

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