【摘 要】
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基于数字信号处理方法在粒子探测器信号处理中应用越来越广泛。论文基于“快通道＋慢通道”结合的方式设计了一个适于SOC设计的粒子探测器读出电路，并采用FPGA仿真平台对所设计
【机 构】
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北京信息科技大学理学院,清华大学微电子学研究所
【基金项目】
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基金项目：国家自然科学基金（60236020）,北京市自然科学基金（4112029）,北京市教委科技面上项目（KM201211232018）.
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基于数字信号处理方法在粒子探测器信号处理中应用越来越广泛。论文基于“快通道＋慢通道”结合的方式设计了一个适于SOC设计的粒子探测器读出电路，并采用FPGA仿真平台对所设计的电路系统进行验证和初步测试。测试结果表明，数字处理器的快速通道和慢速通道能输出正确地梯形脉冲，峰值检测模块能正确地检测出脉冲的到达时间，堆积判弃，脉冲幅度提取电路正常；最终得到的等效噪声电荷为188e，总功耗为26mw，满足高精度低功耗粒子探测器读出电路设计要求。
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