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利用4片ADSP21160处理器设计雷达高速并行信号处理板,整板的峰值运算能力达2400MFLOPS,板间数据吞吐量达1280 MBytes/s,基于该信号处理板易于构成完整的高性能并行信号处理系统.运用高速电路设计方法设计电路,进行了信号完整性分析和仿真.
基于ADSP21160的高速并行信号处理板设计
【摘 要】
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利用4片ADSP21160处理器设计雷达高速并行信号处理板,整板的峰值运算能力达2400MFLOPS,板间数据吞吐量达1280 MBytes/s,基于该信号处理板易于构成完整的高性能并行信号处理系
【机 构】
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哈尔滨工业大学电子工程技术研究所黑龙江哈尔滨150001
【出 处】
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电子工程师
【发表日期】
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2003年6期
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