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提出了一种考虑了布线延迟的片上系统设计流程， 并运用一个新的、全芯片的、门级静态时序分析工具支持片上系统设计。实例设计表明， 该设计方法能使设计者得到更能反映实际版图的延迟值， 验证结果更完整、准确， 从而大大加快芯片设计的周期
片上系统芯片设计与静态时序分析
【摘 要】
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提出了一种考虑了布线延迟的片上系统设计流程， 并运用一个新的、全芯片的、门级静态时序分析工具支持片上系统设计。实例设计表明， 该设计方法能使设计者得到更能反映实际版图
【机 构】
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浙江大学信息与电子工程系
【出 处】
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半导体技术
【发表日期】
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1999年06期
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