基于Verilog HDL到SystemC编译中头文件嵌套关系的研究

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随着大规模集成电路的快速发展,软硬件的协同设计和验证技术变得越来越重要,其中硬件语言Verilog HDL和软件语言SystemC之间的编译转换问题也变得热门。本文研究在Verilog HDL到SystemC编译语义转化中,等效生成Sys-temC头文件的嵌套关系问题。首先提出问题模型,然后利用构造依赖树的算法设计解决问题,最后得到合理的结果。
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