一种基于JTAG的SoC片上调试系统的设计

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：lincl008

【摘要】

：

基于SoC的硬件设计,提出了一种基于JTAG的SoC片上调试系统的设计方法.该调试系统可设置多种工作模式,含有CPU核扫描链和片上总线扫描链.能硬件实现调试启动与停止、断点设置

【作者】

：

虞致国魏敬和

【机构】

：

中国电子科技集团公司第五十八研究所

【出处】

：

微电子学与计算机

【发表日期】

：

2009年5期

【关键词】

：

片上调试 JTAG 系统芯片 on-chip debug JTAG system-on-chip

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基于SoC的硬件设计,提出了一种基于JTAG的SoC片上调试系统的设计方法.该调试系统可设置多种工作模式,含有CPU核扫描链和片上总线扫描链.能硬件实现调试启动与停止、断点设置、单步执行及存储访问等调试功能.对外围IP模块调试诊断时,可绕开CPU核,通过片上总线扫描链直接进行读写访问.该调试系统对其他SoC的设计具有一定的参考价值.

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