【摘 要】
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采用65 nm CMOS工艺，设计了一种宽带低相噪低杂散的Σ-Δ小数分频频率综合器。该频率综合器采用3个压控振荡器以及可编程分频链路实现宽带输出，每个压控振荡器采用自适应衬底偏置技术以减小PVT变化的影响。可编程分频器采用重定时单元同步输出，降低了分频器的相位噪声。自动频率校准模块采用一个可对压控振荡器直接计数的结构，缩短了频率锁定时间。Σ-Δ调制器中采用了陷波滤波结构，降低了高频量化噪声。后仿真
【机 构】
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南京邮电大学电子与光学工程学院微电子学院
【基金项目】
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国家自然科学基金资助项目（62174090）； 江苏省“六大人才高峰”高层次人才资助项目（XYDXX-080）；
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采用65 nm CMOS工艺，设计了一种宽带低相噪低杂散的Σ-Δ小数分频频率综合器。该频率综合器采用3个压控振荡器以及可编程分频链路实现宽带输出，每个压控振荡器采用自适应衬底偏置技术以减小PVT变化的影响。可编程分频器采用重定时单元同步输出，降低了分频器的相位噪声。自动频率校准模块采用一个可对压控振荡器直接计数的结构，缩短了频率锁定时间。Σ-Δ调制器中采用了陷波滤波结构，降低了高频量化噪声。后仿真结果表明，1.2 V电源电压下，该频率综合器可输出正交信号的频率范围为0.2～6 GHz,输出频率为3.762 5 GHz时，相位噪声为-113.59 dBc/Hz@1 MHz,参考杂散为-59.3 dBc,功耗为91 mW。
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