基于FPGA的实时中值滤波算法硬件设计

来源 :工业控制计算机 | 被引量 : 0次 | 上传用户：wooool123

【摘要】

：

为了保证中值滤波在图像处理中的实时性,采用Verilog语言对中值滤波算法进行了硬件设计、Moselsim仿真和TimeQuest时序分析。时序分析仪显示设计的中值滤波硬件算法最高工作频率可达234.91MHz。通过在Altera Cyclone II系列EP2C35F484C6N FPGA平台上进行的算法综合和仿真实验来看,在50MHz工作频率下,使用3×3的模板平滑处理一幅320×240的手指

【作者】

：

汤露程姝

【机构】

：

中国船舶重工集团公司第七一〇研究所

【出处】

：

工业控制计算机

【发表日期】

：

2018年02期

【关键词】

：

脉冲噪声中值滤波 FPGA 时序分析硬件加速 impulse noise median filter FPGA timing analysis hardwa

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