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利用随机信号理论,采用verilog语言设计一种基于FPGA的高斯噪声实时产生器。通过系统仿真分析,该方法可满足工程需要,且具有电路简单,模块化程度高的特点。
基于FPGA的高斯噪声实时产生方法
【摘 要】
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利用随机信号理论,采用verilog语言设计一种基于FPGA的高斯噪声实时产生器。通过系统仿真分析,该方法可满足工程需要,且具有电路简单,模块化程度高的特点。
【机 构】
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海军工程大学海军工程大学武汉
【出 处】
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舰船电子工程
【发表日期】
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2008年6期
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