多芯片组件高速电路布局布线设计及信号传输特性仿真

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以检测器电路为例,利用APD(Advanced Package Designer)软件实现了电路的多芯片组件布局布线设计.结合信号在时域和频域的反射、延时和电磁干扰分析结果,对电路布局布线结构进行了反复调整.采用50MHz脉冲信号触发,噪声裕量增大了124.86mV;上、下过冲分别减小了180.61 mV,465.36mV;传输延时、开关延时和信号建立时间分别缩短了0.407835ns,0.4188ns,0.35968ns,同时输入信号的相对延时不超过0.2ns,电磁干扰强度也减小了10%以上.仿真结果表
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