【摘 要】
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复杂运算中经常需要处理取值范围大、精度高的浮点型数据，一般的低端嵌入式内核中没有浮点硬件单元，采用软件模拟浮点运算往往不能满足实时性要求。现研究基于高性能浮点乘累加
【机 构】
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上海交通大学微电子学院,上海通用识别技术研究所
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复杂运算中经常需要处理取值范围大、精度高的浮点型数据，一般的低端嵌入式内核中没有浮点硬件单元，采用软件模拟浮点运算往往不能满足实时性要求。现研究基于高性能浮点乘累加的通用浮点协处理器设计与实现，重点研究提升浮点运算能力、减少硬件开销等关键技术。实验结果显示向量浮点协处理器运算周期减少40％以上。
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