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在给出倍频电路后,将输入时钟进行倍频,以方便实现整数倍的等占空比分频,对于小数分频则采用双模前置方式,利用将小数部分累加的方法,将N及N＋1分频器混合均匀,以减小输出信号的相位波动.仿真结果表明,设计的程控分频器可适用于对100MHz以内的信号进行任意分频.
程控分频器的FPGA实现
【摘 要】
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在给出倍频电路后,将输入时钟进行倍频,以方便实现整数倍的等占空比分频,对于小数分频则采用双模前置方式,利用将小数部分累加的方法,将N及N＋1分频器混合均匀,以减小输出信号
【机 构】
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宜宾学院物理与电子工程学院
【出 处】
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宜宾学院学报
【发表日期】
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2011年6期
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