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纳米级变频器及加法器的新概率建模方法
纳米级变频器及加法器的新概率建模方法
来源 :后勤工程学院学报 | 被引量 : 0次 | 上传用户:darkage12223
【摘 要】
:
纳米级数字电路应用时,必须考虑设备故障对纳米级设计的影响。在马尔可夫新特性随机场基础上,提出了纳米级变频器和加法器的概率逻辑模型,并用它们来建模概率行为。实验分析显示
【作 者】
:
李建平
王森华
赵刚
【机 构】
:
后勤工程学院国际小波分析应用研究中心,后勤工程学院干部任职培训大队
【出 处】
:
后勤工程学院学报
【发表日期】
:
2009年3期
【关键词】
:
纳米级
概率逻辑
变频器
加法器
nanoscale probability logic inverter adder
【基金项目】
:
国家863计划资助项目(2007AA012423),国家自然科学基金资助项目(60703113,10471151),重庆市自然科学基金资助项目(CSTC,2008BB2034)
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纳米级数字电路应用时,必须考虑设备故障对纳米级设计的影响。在马尔可夫新特性随机场基础上,提出了纳米级变频器和加法器的概率逻辑模型,并用它们来建模概率行为。实验分析显示设备故障的概率分布极大依赖于系统结构及其他运行参数。
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