基于Q矩阵准规则LDPC码半并行编码器的硬件实现

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LDPC码是一种逼近香农限的线性分组码,但其编码运算量较大,常具有码长的二次方复杂度。这里介绍Q矩阵特点和利用Q矩阵构造出的准规则LDPC码不仅可以具有中等码长和码率,而且还可以直接用H矩阵进行编码器设计,使编码运算量具有线性复杂度。然后使用Q矢量,简化了H矩阵存储量,采用半并行结构,提高了编码速度。最后使用Verilog硬件描述语言,在Xilinx Virtex2.XC2V1000上完成了物理实现,为LDPC码在通信系统的硬件实现与应用提供了很好参考设计。
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