基于内外混合流水线的高吞吐率AES结构

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【摘要】

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提出了一种基于加解密轮内外流水线的、高性能及高吞吐率的128 bit AES算法的硬件实现方法.在此之前人们多采用查找表来实现AES算法中的SubBytes和InvSubBytes转换过程,本设

【作者】

：

江磊魏震楠刘明

【机构】

：

东南大学信息科学与工程学院

【出处】

：

电子技术应用

【发表日期】

：

2015年6期

【关键词】

：

AES加密标准复合域运算内外混合流水线 Advanced Encryption Standard（AES）composite field arithmeti

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提出了一种基于加解密轮内外流水线的、高性能及高吞吐率的128 bit AES算法的硬件实现方法.在此之前人们多采用查找表来实现AES算法中的SubBytes和InvSubBytes转换过程,本设计则仅仅使用了进行复合域运算的组合逻辑单元,硬件面积得以缩小,同时还可以将组合逻辑单元划分为6级次级流水线,轮外和轮内流水线得到更深层次的利用.使用本设计方案,在Altera DE2-115设备上以570 MHz频率实现的加密器可以达到73.562 Gb/s的吞吐率.

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