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本文通过对CMOS可编程分频器原理的分析与研究,提出了一种新的可实现任意分频的可编程分频器结构,这种结构大大提高了可编程分频器的输入带宽,同时功耗不大,抗干扰能力强,可适用于锁相环、频率综合器的设计中.该设计在宏力CMOS 0.18um工艺下通过仿真和验证,输入频率可以达到3.3G Hz.
高速CMOS可编程分频器的研究与设计
【摘 要】
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本文通过对CMOS可编程分频器原理的分析与研究,提出了一种新的可实现任意分频的可编程分频器结构,这种结构大大提高了可编程分频器的输入带宽,同时功耗不大,抗干扰能力强,可
【机 构】
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上海大学微电子研究与开发中心
【出 处】
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微计算机信息
【发表日期】
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2007年20期
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