多线程非阻塞指令Cache设计

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：fangfang_936

【摘要】

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非阻塞Cache是指Cache在等待预取数据返回时，还能继续提供指令和数据．首先分析了多线程非阻塞Cache的处理器需求，然后提出其时序要求和一种实现方案．利用SystemVerilog对该方案进

【作者】

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胡孔阳陈鹏桑红石

【机构】

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华中科技大学图像识别与人工智能研究所,华中科技大学多谱信息处理技术国家级重点实验室

【出处】

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微电子学与计算机

【发表日期】

：

2012年5期

【关键词】

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多线程非阻塞 Cache System Verilog 仿真模型

【基金项目】

：

国家自然科学基金(60736010)

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非阻塞Cache是指Cache在等待预取数据返回时，还能继续提供指令和数据．首先分析了多线程非阻塞Cache的处理器需求，然后提出其时序要求和一种实现方案．利用SystemVerilog对该方案进行RTL级建模和性能评估．仿真结果表明，该方案可以很好地应用于多线程、乱序执行处理器的指令引擎设计之中．

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