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期刊论文
一种低相位噪声采样时钟源的设计
一种低相位噪声采样时钟源的设计
来源 :电子科技 | 被引量 : 0次 | 上传用户:stern_pea
【摘 要】
:
分析了锁相环频率合成器与数字直接频率合成器的原理,阐述了二者性能的优劣。并在此基础上设计了一款低相位噪声的采样时钟源。该频率源结合锁相环和直接数字频率合成器的优
【作 者】
:
蒋小强
石玉
苏安刚
赵宝林
【机 构】
:
电子科技大学微电子与固体电子学院
【出 处】
:
电子科技
【发表日期】
:
2014年6期
【关键词】
:
频率源
数字直接频率合成器
滤波器
相位噪声
phase locked loop
digital direct synthesis
filter
phas
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分析了锁相环频率合成器与数字直接频率合成器的原理,阐述了二者性能的优劣。并在此基础上设计了一款低相位噪声的采样时钟源。该频率源结合锁相环和直接数字频率合成器的优势,在75 MHz时相位噪声可达-119 dBc@1 kHz、-116 dBc@100 kHz。
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