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本文介绍了一种在传统计算机组成原理实验仪上，开设Cache实验时的主存储器的接口设计方法，并给出了电路和数据通路分析，最后进行了性能比较。
Cache实验中的主存储器接口设计
【摘 要】
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本文介绍了一种在传统计算机组成原理实验仪上，开设Cache实验时的主存储器的接口设计方法，并给出了电路和数据通路分析，最后进行了性能比较。
【机 构】
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杭州电子工业学院计算机分院
【出 处】
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实验室研究与探索
【发表日期】
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2004年4期
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