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期刊论文
用一种新型FPGA逻辑单元实现乘法器
用一种新型FPGA逻辑单元实现乘法器
来源 :重庆工学院学报:自然科学版 | 被引量 : 0次 | 上传用户:liujmjm
【摘 要】
:
提出了一种基于改进进位链的FPGA逻辑单元结构,并用4×4二进制乘法器进行了验证,仿真实验表明,新型逻辑单元结构具有较高性能,实现乘法器只需要18个逻辑单元,而CyclonⅡ器件需
【作 者】
:
李绪诚
龙飞
徐昊
陆安江
张正平
【机 构】
:
贵州大学电子科学与信息技术学院,贵州民族学院数学与计算机学院,贵州通信建设设计资询有限公司
【出 处】
:
重庆工学院学报:自然科学版
【发表日期】
:
2008年5期
【关键词】
:
FPGA
逻辑单元
进位链
乘法器
FPGA
logic cell
carry chains
multiplier
【基金项目】
:
国家自然科学基金资助项目(60666001).
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提出了一种基于改进进位链的FPGA逻辑单元结构,并用4×4二进制乘法器进行了验证,仿真实验表明,新型逻辑单元结构具有较高性能,实现乘法器只需要18个逻辑单元,而CyclonⅡ器件需要39个逻辑单元,因此新型的逻辑单元性能明显优于目前商用的EPGA。
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