应用预取策略的行缓冲指令Cache设计

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：laire723

【摘要】

：

行缓冲是一种有效的低功耗方案,但其极大地降低了处理器的运算性能.设计并实现了使用预取策略的行缓冲Cache,使用一个缓冲行来预取存储在L1Cache中的指令,从而降低了行缓冲结

【作者】

：

李伟立于立新

【机构】

：

北京微电子技术研究所

【出处】

：

微电子学与计算机

【发表日期】

：

2011年1期

【关键词】

：

行缓冲预取性能 Line Buffer prefetch performance

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行缓冲是一种有效的低功耗方案,但其极大地降低了处理器的运算性能.设计并实现了使用预取策略的行缓冲Cache,使用一个缓冲行来预取存储在L1Cache中的指令,从而降低了行缓冲结构中由于容量缺失而造成的流水线停顿,提升了处理器的运算性能.以Leon2的VHDL模型为试验环境进行了验证,带有预取策略的行缓冲结构较原来的结构平均提升了12.4%.

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