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提出了一种针对HDLC码流的高精度的时钟恢复电路。方案通过FPGA的可编程模块化设计,包含了小数分频、数据边沿采样、硬件倍频PLL及HDLC标志码脉宽测量等关键技术,实现从HDLC数据码流中恢复高精度时钟。经硬件实验验证,性能指标优秀,有较强的实用性,应用广泛。
HDLC码流高精度时钟恢复电路的FPGA实现
【摘 要】
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提出了一种针对HDLC码流的高精度的时钟恢复电路。方案通过FPGA的可编程模块化设计,包含了小数分频、数据边沿采样、硬件倍频PLL及HDLC标志码脉宽测量等关键技术,实现从HDLC
【机 构】
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国网电力科学研究院信息通信技术分公司
【出 处】
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电力系统通信
【发表日期】
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2010年9期
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