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本文针对维特比译码算法中的两个行的解决方案,并应用该方案在Xilinx Spartan Ⅱ FPGA上实现了速率为64Kb/s的软判决译码器.
维特比译码器实现中的关键技术
【摘 要】
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本文针对维特比译码算法中的两个行的解决方案,并应用该方案在Xilinx Spartan Ⅱ FPGA上实现了速率为64Kb/s的软判决译码器.
【机 构】
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上海交通大学电子工程系
【出 处】
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电子测量技术
【发表日期】
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2006年3期
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