【摘 要】
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针对传统容错嵌入式计算机故障检测方式较少,故障检测实时性不高,并且多余度结构中单个计算节点自身的可靠性较低的问题,给出了一种基于FPGA的高可用容错计算机设计思路。该
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针对传统容错嵌入式计算机故障检测方式较少,故障检测实时性不高,并且多余度结构中单个计算节点自身的可靠性较低的问题,给出了一种基于FPGA的高可用容错计算机设计思路。该计算机采用Lock Step技术作为处理器和存储器的故障检测方式,并应用TMR技术和局部重加载技术来提高接口电路FPGA设计的可靠性,具有丰富的故障监测方式,在多层级上增加了故障检测的覆盖率和实时性,显著提高了多余度结构中单个计算节点自身的可靠性,而且具备智能故障管理和故障自恢复能力。
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