【摘 要】
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时钟数据恢复（CDR）电路是通信传输设备中的重要部分，对于突发式的接收，基于锁相环的传统的CDR往往不能满足其快速同步的要求。对此，文章采用过采样方式基于FPGA设计实现了一种全数
【机 构】
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清华大学电子工程系微波与数字通信技术国家重点实验室
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时钟数据恢复（CDR）电路是通信传输设备中的重要部分，对于突发式的接收，基于锁相环的传统的CDR往往不能满足其快速同步的要求。对此，文章采用过采样方式基于FPGA设计实现了一种全数字化的I55．52Mb／s下的CDR电路。理论分析、仿真和炙验测试结果表明，该CDR电路可以有效地对相位变化实现快速同步，有很大的捕捉范围，且系统较锁相环便于集成。
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