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以FPGA技术为基础，以VerilogHDL为载体，设计了遵守Wishbone片上总线规范的IP核接口，实现了片上系统的IP核互联。
基于Wishbone片上总线的IP核的互联
【摘 要】
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以FPGA技术为基础，以VerilogHDL为载体，设计了遵守Wishbone片上总线规范的IP核接口，实现了片上系统的IP核互联。
【机 构】
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交通大学光电与智能控制教育部重点实验室
【出 处】
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微计算机信息
【发表日期】
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2009年20期
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